CSpace

浏览/检索结果: 共5条,第1-5条 帮助

限定条件                    
已选(0)清除 条数/页:   排序方式:
RISC指令集众核处理器功能验证与实现 期刊论文
计算机工程与应用, 2014, 卷号: 000, 期号: 021, 页码: 54
作者:  朱博元;  刘高辉;  李政运;  安述倩
收藏  |  浏览/下载:5/0  |  提交时间:2023/12/04
众核处理器  功能验证  覆盖率  时序验证  功耗评估  
基于Bayes推断的基因芯片探针特异性估计模型 期刊论文
计算机工程与应用, 2007, 卷号: 43.0, 期号: 024, 页码: 100
作者:  彭柳;  冯圣中
收藏  |  浏览/下载:5/0  |  提交时间:2023/12/04
探针设计序列相似性估计贝叶斯推断特异性  
网络处理器体系结构分析 期刊论文
计算机工程与应用, 2004, 卷号: 40.0, 期号: 005, 页码: 135
作者:  李秋江;  韦卫;  贺志强
收藏  |  浏览/下载:5/0  |  提交时间:2023/12/04
网络处理器  体系结构  并行处理  隐藏延迟  网络应用  
虫洞路由芯片的伸缩缓冲区设计与实现 期刊论文
计算机工程与应用, 2002, 卷号: 38.0, 期号: 007, 页码: 17
作者:  安学军;  祝明发;  高文学;  吴冬冬
收藏  |  浏览/下载:5/0  |  提交时间:2023/12/04
伸缩缓冲区  流量控制  虫洞路由芯片  交换机  路由器  设计  
可测试性设计技术在一款通用CPU芯片中的应用 期刊论文
计算机工程与应用, 2002, 卷号: 38.0, 期号: 016, 页码: 191
作者:  李华伟;  李晓维;  尹志刚;  吕涛;  何蓉晖
收藏  |  浏览/下载:7/0  |  提交时间:2023/12/04
可测试性设计  CPU芯片  扫描设计  TEEE1149.1标准