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| Taming Process Variations in CNFET for Efficient Last-Level Cache Design 期刊论文
IEEE TRANSACTIONS ON VERY LARGE SCALE INTEGRATION (VLSI) SYSTEMS, 2022, 卷号: 30, 期号: 4, 页码: 418-431
作者: Xu, Dawen; Feng, Zhuangyu; Liu, Cheng; Li, Li; Wang, Ying; Li, Huawei; Li, Xiaowei
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CNTFETs Delays Transistors Layout Very large scale integration Radio frequency Energy consumption nanotube field-effect transistor (CNFET) last-level cache (LLC) process variation (PV) variation-aware cache |
| 无权访问的条目 学位论文
作者: 王成龙
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| 无权访问的条目 学位论文
作者: 杜振林
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| 无权访问的条目 学位论文
作者: 周艳红
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| 无权访问的条目 学位论文
作者: 郭树盛
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| 无权访问的条目 学位论文
作者: 苏东锋
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| 无权访问的条目 学位论文
作者: 李超
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| 无权访问的条目 学位论文
作者: 陈倩
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| 无权访问的条目 学位论文
作者: 郝帅
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| 无权访问的条目 期刊论文
作者: 沈海华
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